`timescale 1ns / 1ps
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// Company:
// Engineer:
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// Create Date: 2023/12/10 21:21:19
// Design Name:
// Module Name: ROM32K
// Project Name:
// Target Devices:
// Tool Versions:
// Description:
//
// Dependencies:
//
// Revision:
// Revision 0.01 - File Created
// Additional Comments:
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module ROM32K(
    input clk,
    input rst,
    input [15:0] address,
    output [15:0] out   // out = ROM[address]
  );

  logic[15:0] rom[32767: 0];
  initial
  begin
    $readmemb("uart.hack", rom);
  end
  assign out = rom[address[14:0]];
endmodule
